Encounter-快速入門(mén)教程ppt課件

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Ecounter 快速入門(mén)教程,1,1. 數(shù)據(jù)準(zhǔn)備,必要數(shù)據(jù)： A. 綜合后Verilog網(wǎng)表，通常以.v結(jié)尾； B. 標(biāo)準(zhǔn)單元LEF庫(kù)文件； 可選數(shù)據(jù)： A. IO/Pin位置配置文件； B. MMMC等。。。,2,Encounter標(biāo)準(zhǔn)流程,極簡(jiǎn)流程,3,2. 啟動(dòng)Encounter,工作目錄管理: 假設(shè)項(xiàng)目名稱(chēng)為project， 在project下新建lib、work文件夾 xxx/project/lib （存放各種庫(kù)文件） xxx/project/work （工作數(shù)據(jù)區(qū)） 在work下打開(kāi)打開(kāi)終端： 輸入encounter 不能加“&” ，回車(chē),,4,3. 菜單簡(jiǎn)介,File ：各種數(shù)據(jù)文件保存、導(dǎo)入 Edit ：各種數(shù)據(jù)屬性編輯修改 Floorplan：布局設(shè)置 Power：配置電源/地 Place：放置標(biāo)準(zhǔn)單元 Route：布線(xiàn)器 Option：配置Encounter各項(xiàng)屬性,5,4.Import Design,File – Import Design,強(qiáng)大的幫助文檔，一切不懂都可以從help中找到答案,6,File – Import Design,Advanced頁(yè)： 選擇Power項(xiàng)，添加Power Nets： Ground Nets：,保存設(shè)置： Save可將本次的設(shè)置保存到一個(gè)文件中，下次再Load的這個(gè)文件即可。,7,,,8,5. Floorplan規(guī)劃,設(shè)置Die的面積、長(zhǎng)寬、利用率等,建立一個(gè)初始化的Floorplan,9,5.1 Specify Floorplan：Basic,Size：指定大小 Die/IO/Core Coordinates： 通過(guò)Die/IO/Core Coordinate來(lái)指定大小。 有兩種方式來(lái)設(shè)定die的大?。?◆ Core size by Aspect Ratio ◆ Core Size by Width and Height Core Margins也是有兩種方式 ◆ Core to Die Boundary ◆ Core to IO Boundary Core邊界一般都是需要的，用來(lái)放置Power Ring，與其他模塊的隔離區(qū),,10,5.2 Specify—Floorplan：Advanced,設(shè)置標(biāo)準(zhǔn)單元陣列排布方式 選擇Site； 改變Rows設(shè)置 改變Rows spacing 改變Row height 改變底部IO的排列方向,11,6. 設(shè)置IO的位置,啟動(dòng)Pin Editor：Edit—Pin Editor,1 選擇要設(shè)置 的Pin,2. 設(shè)定放置邊界，層次,3. 設(shè)置起始位置、間距,,,12,6.2 導(dǎo)出IO配置文件,File—Save—I/O File 保存為.io文件，方便下次導(dǎo)入使用，或者添加在Import Design中IO設(shè)置中,Note: Encounter的每一步操作都可以保存到一個(gè)記錄文件中，如果要恢復(fù)只需load這個(gè)文件就可以： File—Load File—Save 所以每一個(gè)關(guān)鍵操作后都要單獨(dú)保存，如Specify Floorplan、Power Plan、Place、Route等,13,7. 配置電源、地,Power 菜單,添加外圍供電環(huán)路,添加StdCell Rows的供電線(xiàn)路,14,7.1 Add Ring：Basic,添加電源/地的節(jié)點(diǎn)名稱(chēng),設(shè)置Ring的類(lèi)型,設(shè)置縱向、橫向的layer、width、spacing等,15,7.2 Add Ring：Advanced,選擇Die的哪一邊需要添加Ring,最后OK確認(rèn),16,7.3 Add Stripe：,添加電源/地節(jié)點(diǎn)名稱(chēng)，配置線(xiàn)寬、間距以及層次使用,設(shè)置每一組Stripe的pitch,設(shè)置Stripe的起始和結(jié)束位置,最后OK確認(rèn),17,完成后,Ring,Stripe,18,8. Place & Route,8.1 放置標(biāo)準(zhǔn)單元,Place—Place Standard Cell Run Full Placement：放置全部 Run Incremental Placement：放置增加的,設(shè)置CPU個(gè)數(shù)以增加place的速度,Include Pre-Place Optimization：放置前優(yōu)化netlist Include In-Place Optimization： 在放置優(yōu)化Timing constraints,19,Place之后（無(wú) Stripe和Top/Bottom Ring）,20,8.2 Route,Special Route： 連接Cell、block、Pad的電源和地到全局電源地。 Trial Route： 快速的布線(xiàn)，提取參數(shù)用于時(shí)序分析； 用于分析布線(xiàn)阻塞情況； 不完全布線(xiàn)，DRC&LVS不一定會(huì)通過(guò)； NanoRoute： 精細(xì)完整的布線(xiàn) Mixed Signal： 基于圖形的布線(xiàn)器 適用于小型的定制block；,21,Special Route,選擇需要布線(xiàn)的節(jié)點(diǎn)和端口,選擇布線(xiàn)層次,最后確認(rèn),22,23,8.3 Nano Route,,,勾選 Global Route Detail Route,設(shè)置CPU核心數(shù)，增加布線(xiàn)速度,Route—NanoRoute—Route,24,布線(xiàn)結(jié)果,,在終端下可看到布線(xiàn)的結(jié)果，如果有違反，需重復(fù)Place—Route 過(guò)程，直到violation為零，如果錯(cuò)誤較少，也可以手工修改， 打開(kāi)： Tools—Violation Browser 查看詳細(xì)情況。,25,8.4 添加Filler 在Rows的空白處添加Nwell/Ntap、Ptap，保證Rows的DRC&LVS通過(guò)。Filler一般為縱向布線(xiàn)Pitch的整數(shù)倍 Place—Add Phycical Cell—Add Filler,選擇Filler cell,如果有DRC Violation導(dǎo)致不能添加，需把Mode選項(xiàng)里面的 Perform DRC Violation Checking去掉,,Add Filler 也可以在Place完成之后添加,26,9. 導(dǎo)出數(shù)據(jù),選擇輸出的數(shù)據(jù)類(lèi)型,填寫(xiě)輸出數(shù)據(jù)的名稱(chēng),Layer map 文件，對(duì)應(yīng)到PDK的layer層次,輸出數(shù)據(jù)的庫(kù)名稱(chēng),數(shù)據(jù)Top cell name,27,Map File 范例： ## layer name layer 屬性 stream layer number data type number A1 NET 7 0 A1 SPNET 7 0 A1 PIN 7 0 A1 FILL 7 0 A1 VIA 7 0 A1 VIAFILL 7 0 NAME A1/PIN 7 253 W2 ALL 8 0 T2 NET 84 0 T2 SPNET 84 0 T2 PIN 84 0 T2 FILL 84 0 T2 VIA 84 0 T2 VIAFILL 84 0 NAME T2/PIN 9 253 DIEAREA ALL 230 0,28,