實(shí)驗(yàn)2算術(shù)邏輯運(yùn)算實(shí)驗(yàn).ppt

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控制信號(hào)發(fā)生單元 W RUNIT T1 T4為時(shí)序信號(hào)輸入端 它們和實(shí)驗(yàn)單元中相應(yīng)的時(shí)序信號(hào)控制端全部相連可接STATEUNIT中的KK2來(lái)產(chǎn)生單脈沖也可以接STATEUNIT中的TS1 TS4 加上時(shí)序控制電路產(chǎn)生自動(dòng)脈沖信號(hào) 運(yùn)算器單元 ALUUNIT 兩片74LS181構(gòu)成并 串型8位ALUALU輸出通過(guò)三態(tài)門74LS245控制 將數(shù)據(jù)送到AUJ3 控制信號(hào)為ALU BUS 低電平有效 8位寄存器DR1 DR2 74LS373 作為暫存工作寄存器 LDDR1 LDDR2高電平有效 將總線的數(shù)據(jù)暫存 T4為脈沖信號(hào) S0 S4以及M Cn控制ALU的運(yùn)算 參見(jiàn) 計(jì)算機(jī)組成原理 P49 實(shí)驗(yàn)?zāi)康?了解運(yùn)算器的組成結(jié)構(gòu)掌握運(yùn)算器的工作原理掌握簡(jiǎn)單運(yùn)算器的數(shù)據(jù)傳輸通路驗(yàn)證運(yùn)算功能發(fā)生器74LS181的組合功能實(shí)驗(yàn)設(shè)備 TDN CM 教學(xué)實(shí)驗(yàn)系統(tǒng)一套 運(yùn)算器單元電路圖 兩片74LS181構(gòu)成并 串型8位ALU ALU輸出通過(guò)三態(tài)門74LS245控制 將數(shù)據(jù)送到AUJ3 8位寄存器DR1 DR2 74LS373 作為暫存工作寄存器 實(shí)驗(yàn)原理 運(yùn)算器單元電路圖運(yùn)算器的兩個(gè)數(shù)據(jù)輸入端由兩個(gè)數(shù)據(jù)暫存器DR1 DR2來(lái)鎖存數(shù)據(jù) 輸入時(shí) 鎖存器的控制端LDDR1和LDDR2為高電平 當(dāng)T4脈沖到來(lái)時(shí) 總線上的數(shù)據(jù)就被鎖存進(jìn)DR1和DR2 數(shù)據(jù)輸入 輸入開(kāi)關(guān)經(jīng)過(guò)一個(gè)三態(tài)門 74LS245 和內(nèi)總線相連 該三態(tài)門的控制信號(hào)SW B取低電平時(shí) 開(kāi)關(guān)上的數(shù)據(jù)通過(guò)三態(tài)門而送入內(nèi)總線 數(shù)據(jù)輸出 若要將運(yùn)算結(jié)果輸出到總線 將三態(tài)門74LS245的控制端ALU B置低電平 否則輸出高阻態(tài) 總線數(shù)據(jù)顯示燈 BUSUNIT 與內(nèi)總線相連 顯示內(nèi)總線上的數(shù)據(jù) 脈沖信號(hào) 實(shí)驗(yàn)電路中所有的時(shí)序信號(hào)均已連至 W RUNIT 單元中的相應(yīng)時(shí)序信號(hào)引出端 只需將 W RUNIT 單元中的T4接至 STATEUNIT 單元中的微動(dòng)開(kāi)關(guān)KK2的輸出端 按動(dòng)KK2 就可獲得實(shí)驗(yàn)所需的單脈沖 接線圖 實(shí)驗(yàn)內(nèi)容 向DR1和DR2存入數(shù)據(jù)顯示DR1和DR2寄存器內(nèi)容將輸入的數(shù)據(jù)進(jìn)行各種算術(shù)及邏輯運(yùn)算 表格 DR1 DR2 S3 S2 S1 S0 M Cn F 以上需要撥動(dòng)哪些開(kāi)關(guān) 每個(gè)開(kāi)關(guān)各起什么作用 實(shí)驗(yàn)報(bào)告思考題 顯示DR1和DR2寄存器內(nèi)容的原理是否可以同時(shí)打開(kāi)SW B和ALU B 為什么 如何控制運(yùn)算器使其進(jìn)行運(yùn)算 都有哪些信號(hào) 每個(gè)信號(hào)必須滿足什么條件